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快速路徑PCB電源完整性的簽署
Cadence設(shè)計(jì)系統(tǒng)已經(jīng)宣布了Sigrity 2017技術(shù)組合的可用性，其中介紹了一些專門為提高PCB功耗和信號完整性而設(shè)計(jì)的關(guān)鍵特性。
Cadence Sigrity組合的最新版本中包含的特性包括Allegro PowerTree拓?fù)洳榭雌骱途庉嬈�，它使設(shè)計(jì)人員能夠在設(shè)計(jì)周期的早期快速評估電源交付決策。Sigrity的最新版本還包括一個(gè)PCI Express (PCIe) 4.0合規(guī)工具包，用于在今年晚些時(shí)候通過認(rèn)證時(shí)檢查信號完整性是否符合最新的PCIe規(guī)范。
加速PCB電源和信號完整性信號的能力不僅是設(shè)計(jì)獨(dú)立電路板的關(guān)鍵，也是設(shè)計(jì)完整的終端產(chǎn)品的一個(gè)重要因素。Sigrity 2017是Cadence系統(tǒng)設(shè)計(jì)支持技術(shù)之一，旨在幫助公司創(chuàng)造創(chuàng)新的、高質(zhì)量的電子產(chǎn)品，從芯片到電路板，到整個(gè)系統(tǒng)。
在設(shè)計(jì)周期的早期確定電源交付的路徑對PCB設(shè)計(jì)團(tuán)隊(duì)至關(guān)重要。PowerTree用戶界面獨(dú)特地允許查看電源拓?fù)�，以便快速和�?zhǔn)確地確定電源傳輸?shù)淖罴崖窂�。隨著設(shè)計(jì)的變化，這項(xiàng)技術(shù)還可以方便地進(jìn)行編輯。存儲在PowerTree環(huán)境中的信息稍后將在設(shè)計(jì)周期中使用，以提供路由后電源完整性分析的自動(dòng)化設(shè)置，以更快地關(guān)閉。
Sigrity 2017版還包含了通過分析模型管理器管理power integrity模型的庫。當(dāng)設(shè)計(jì)組件被重用時(shí)，可以從分析模型管理器庫中保存和自動(dòng)檢索模型。這種方法還通過自動(dòng)化流程來加速開發(fā)，而這些流程在過去都是由人工反復(fù)執(zhí)行的。
Sigrity 2017還幫助設(shè)計(jì)師將最新的PCIe技術(shù)用于高速互連，以確保信號的完整性。它在Sigrity SystemSI串行鏈路分析工具中包含了一個(gè)PCIe 4.0接口的遵從性工具包，可以自動(dòng)對信號質(zhì)量標(biāo)準(zhǔn)進(jìn)行限定，而不是根據(jù)標(biāo)準(zhǔn)文檔手工檢查和測量。
Cadence高級產(chǎn)品工程總監(jiān)Steve Durrill說:“Sigrity 2017系列產(chǎn)品包括旨在提高效率和加速設(shè)計(jì)過程的技術(shù)。”“我們更新的每一個(gè)功能都得到了改進(jìn)，目的是幫助我們的客戶更快地獲得高性能產(chǎn)品。”甚至在該標(biāo)準(zhǔn)被批準(zhǔn)之前，我們就已經(jīng)開發(fā)了PCIe 4.0的合規(guī)工具包，這是關(guān)注客戶需求和上市時(shí)間的一個(gè)明顯而重要的例子。
“Teradyne與Cadence緊密合作，使我們的PCB設(shè)計(jì)人員在power integrity設(shè)計(jì)中發(fā)揮更積極的作用，”設(shè)計(jì)技術(shù)組經(jīng)理Paul Carlin說。“Sigrity組合的新更新將有助于提高效率，加快我們的產(chǎn)品開發(fā)時(shí)間。這是Teradyne的一個(gè)重要優(yōu)勢。
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