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全面、實(shí)時、設(shè)計(jì)的DFM技術(shù)問世
發(fā)布者: 發(fā)布時間:2018/3/19 17:10:12 閱讀:

全面、實(shí)時、設(shè)計(jì)的DFM技術(shù)問世。

Cadence設(shè)計(jì)系統(tǒng)已經(jīng)宣布了Cadence Allegro PCB DesignTrue DFM技術(shù),這是一種實(shí)時的、在設(shè)計(jì)中進(jìn)行的設(shè)計(jì)制造(DFM)檢查與電氣、物理和間隔設(shè)計(jì)規(guī)則檢查(DRCs)集成的第一個解決方案。

 

創(chuàng)新的新技術(shù),集成到Allegro PCB編輯器中,使PCB設(shè)計(jì)人員能夠立即識別和糾正錯誤,早在制造信號之前。通過早期發(fā)現(xiàn)錯誤,設(shè)計(jì)團(tuán)隊(duì)減少返工,縮短設(shè)計(jì)周期,并加速新產(chǎn)品開發(fā)和引入過程,可能至少在每一次迭代中至少節(jié)約一天,并在數(shù)天內(nèi)節(jié)約數(shù)天。

 

不同于在執(zhí)行DFM檢查時以批處理模式運(yùn)行的生產(chǎn)signoff工具,DesignTrue DFM技術(shù)在設(shè)計(jì)時提供了持續(xù)的設(shè)計(jì)反饋,消除了PCB設(shè)計(jì)人員和DFM檢查團(tuán)隊(duì)之間令人沮喪和耗時的設(shè)計(jì)驗(yàn)證修復(fù)迭代。當(dāng)PCB設(shè)計(jì)人員到達(dá)最后的DFM簽到時,他們已經(jīng)知道他們的設(shè)計(jì)符合制造規(guī)則,從而導(dǎo)致了一個更平滑的signoff和切換到制造伙伴和一個更短,更可預(yù)測的設(shè)計(jì)周期。

 

DesignTrue DFM技術(shù)與目前用于電氣、物理和間隔規(guī)則的已證實(shí)的Allegro約束設(shè)計(jì)流和在線檢測解決方案是一致的。設(shè)計(jì)真正的DFM技術(shù)提供廣泛的檢查,以確保設(shè)計(jì)可制造性。銅的特性,如跟蹤、引腳、相對于板綱和其他銅特征的間距可以實(shí)時驗(yàn)證,獨(dú)立于電氣和網(wǎng)絡(luò)的規(guī)則。

 

新技術(shù)使得配置、應(yīng)用上下文和重用制造規(guī)則變得更加容易。DesignTrue DFM技術(shù)支持DFM規(guī)則的導(dǎo)入和導(dǎo)出,并處理超過2000個高級檢查。此外,它還使用了一種新的、更友好的DRC瀏覽器,能夠一次處理一類錯誤。約束是高度可配置的,具有啟用和禁用組和整個規(guī)則類別或單個規(guī)則的能力。規(guī)則可以應(yīng)用于etch模式,非etch模式,以及在堆棧模式下,使設(shè)計(jì)師能夠隔離層,幾何圖形和剪紙。新瀏覽器還具有一個集成的DRC描述和圖形,特點(diǎn)是DRCs的類型,并提供一個DRC計(jì)數(shù)圖。用戶可以快速排序、瀏覽和評論,以及waive和unwaive DRCs。

 

“越來越多的PCB復(fù)雜性正在擴(kuò)展我們的設(shè)計(jì)周期,使它們更具挑戰(zhàn)性,”斯科特·米勒說,他是自由CAD服務(wù)公司的首席運(yùn)營官。“通過使用Cadence Allegro PCB DesignTrue DFM技術(shù),我們的PCB設(shè)計(jì)人員可以放心,他們是第一次正確地設(shè)計(jì)電路板,考慮到電子、物理和制造的限制。這消除了不必要的迭代和制造的signoff過程,并且可以節(jié)省我們幾天到幾周的時間。

 

“加快新產(chǎn)品開發(fā)和引進(jìn)是我們的客戶的首要任務(wù),”Cadence公司的高級副總裁兼總經(jīng)理Tom Beckley說。“15年多來,我們的客戶一直依賴于電子和物理領(lǐng)域的快板限制驅(qū)動流和在線檢測解決方案。”作為我們的系統(tǒng)設(shè)計(jì)支持策略的一部分,我們現(xiàn)在將同樣的方法應(yīng)用到DFM檢查中。將我們的解決方案擴(kuò)展到制造領(lǐng)域,使電子設(shè)備制造商能夠更快、更有信心地將產(chǎn)品推向市場。

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