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低抖動時鐘降低基礎設施成本
聲稱提供行業(yè)領先的抖動性能的高速網(wǎng)絡、通信和數(shù)據(jù)中心設備,稱為clock-tree-on-a-chip Si534x,由硅實驗室。投資組合包括時鐘發(fā)生器和集成multi-PLL抖動衰減器。單片機,ultra-low-jitter計時設備結合時鐘合成和抖動衰減功能,降低成本和復雜性的光學網(wǎng)絡、無線基礎設施、寬帶接入/聚合載體以太網(wǎng)、測試和測量、和企業(yè)/數(shù)據(jù)中心設備包括邊緣路由器、交換機、存儲和服務器。
帶寬需求上升意味著各種在不同頻率的時鐘,信號格式和電壓水平是必需的。抖動性能需求支持的最高數(shù)據(jù)速率10/40/100G網(wǎng)絡也很苛刻。抖動衰減器和時鐘生成器利用頻率和集成所有離散時間函數(shù)合并成一個單片機時鐘集成電路解決方案。
Si5347/46/45/44/42抖動衰減器和Si5341/40時鐘生成器提供一個我²C-configurable平臺具有頻率轉換功能和一流抖動性能(100 fs RMS)。通過結合四個獨立jitter-attenuating PLLs和五ultra-low-jitter MultiSynth分數(shù)合成器,生成10輸出的設備能夠與任何組合從100赫茲至100 mhz的頻率選擇輸出格式(LVDS LVPECL,CML,HCSL和LVCMOS)。這種級別的集成和頻率靈活性是聲稱消除需要多個時鐘ICs,離散水平翻譯、循環(huán)過濾和電源濾波器組件,降低材料成本和復雜性法案同時還提供超過50%的保證金嚴格10/40/100G抖動規(guī)范。
客戶可以上傳他們的公司使用ClockBuilder Pro軟件自定義配置。工廠預先Si534x時鐘樣品船在兩周內(nèi),加速整個產(chǎn)品開發(fā)過程與行業(yè)的定制樣品交貨期最短。
工廠預先編排的時鐘發(fā)生器和抖動衰減器樣品現(xiàn)在有QFN 7 x 7毫米包。
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